M12L128324A (2C) 1M x 32 Bit x 4 Banks Synchronous SDRAM DRAM
M12L128324A-7BG2C SDRAM DRAM 芯片特征
JEDEC标准3.3V电源
LVTTL兼容多路复用地址
四家银行运营
带地址键程序的MRS循环
-CAS延迟(2和3)
-连拍长度(1、2、4、8和整页)
-突发类型(顺序和交错)
所有输入均在正向边缘处采样
系统时钟
DQM用于遮蔽
自动和自刷新
64ms刷新周期(4K周期)
M12L128324A-7BG2C说明
M12L128324A是134217728位同步高数据速率动态RAM,由4 x 1048576个字乘32位组成。 同步设计允许使用系统时钟进行精确的周期控制。每个时钟周期都可以进行I/O事务。 工作频率范围、可编程突发长度和可编程延迟允许同一设备用于各种高带宽、高性能存储系统应用。
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